地震数据采集中基于FPGA的多DDR SDRAM控制器设计
地震数据采集中基于FPGA的多DDR SDRAM控制器设计
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22 2021-04-28
pdf | 3.0MB | 7页
正文 简介
实现高速大容量数据的无死时间乒乓存储是地震数据采集系统的一项关键技术,本设计采用在一片FPGA中,通过共享同一个PLL和DLL来实现2个DDR SDRAM控制器,应用于海上高精度地震拖缆采集与记录系统中光纤控制接口板上,完成对水下地震采集数据的接收、乒乓缓存、数据拼接及时序转道序功能.最终系统仿真和测试结果表明,该控制器能够在133MHz频率上稳定运行,达到了预期的设计目标.
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